# Summary

[Порядок выполнения лабораторных работ для групп](index.md)
[Предисловие](Intro.md)

---

# Введение

- [О данном разделе](Introduction/README.md)
- [Что такое Язык Описания Аппаратуры](Introduction/What%20is%20HDL.md)
- [Как работает ПЛИС](Introduction/How%20FPGA%20works.md)
- [Этапы реализации проекта в ПЛИС](Introduction/Implementation%20steps.md)

---

# Лабораторные работы

- [Лабораторная №1. Сумматор](Labs/01.%20Adder/README.md)
- [Лабораторная №2. АЛУ](Labs/02.%20Arithmetic-logic%20unit/README.md)
- [Лабораторная №3. Регистровый файл и внешняя память](Labs/03.%20Register%20file%20and%20memory/README.md)
- [Лабораторная №4. Простейшее программируемое устройство](Labs/04.%20Primitive%20programmable%20device/README.md)
- [Лабораторная №5. Основной дешифратор](Labs/05.%20Main%20decoder/README.md)
- [Лабораторная №6. Тракт данных](Labs/06.%20Datapath/README.md)
- [Лабораторная №7. Внешняя память](Labs/07.%20External%20memory/README.md)
- [Лабораторная №8. Блок загрузки и сохранения](Labs/08.%20Load-store%20unit/README.md)
- [Лабораторная №9. Интеграция LSU](Labs/09.%20LSU%20Integration/README.md)
- [Лабораторная №10. Подсистема прерываний](Labs/10.%20Interrupt%20subsystem/README.md)
- [Лабораторная №11. Интеграция подсистемы прерываний](Labs/11.%20Interrupt%20integration/README.md)
- [Лабораторная №12. Дейзи-цепочка](Labs/12.%20Daisy%20chain/README.md)
- [Лабораторная №12. Периферийные устройства](Labs/12.%20Peripheral%20units/README.md)
- [Лабораторная №13. Программирование](Labs/13.%20Programming/README.md)
- [Лабораторная №14. Программатор](Labs/14.%20Programming%20device/README.md)
- [Лабораторная №15. Оценка производительности](Labs/15.%20Coremark/README.md)

---

# Базовые конструкции SystemVerilog

- [Описание раздела](Basic%20Verilog%20structures/README.md)
- [Модули](Basic%20Verilog%20structures/Modules.md)
- [Мультиплексоры](Basic%20Verilog%20structures/Multiplexors.md)
- [Регистры](Basic%20Verilog%20structures/Registers.md)
- [Конкатенация](Basic%20Verilog%20structures/Concatenation.md)
- [Защелки](Basic%20Verilog%20structures/Latches.md)
- [О различиях между блокирующими и неблокирующими присваиваниями](Basic%20Verilog%20structures/Assignments.md)
- [Контроллеры](Basic%20Verilog%20structures/Controllers.md)
- [Тестовое окружение](Basic%20Verilog%20structures/Testbench.md)

---

# Основы Vivado

- [Создание проекта в Vivado](Vivado%20Basics/Vivado%20trainer.md)
- [Взаимодействие с окном исходников проекта Vivado](Vivado%20Basics/How%20to%20use%20Source%20Window.md)
- [Как сгенерировать логическую схему](Vivado%20Basics/How%20to%20open%20a%20schematic.md)
- [Ошибки элаборации](Vivado%20Basics/Elaboration%20failed.md)
- [Запуск симуляции](Vivado%20Basics/Run%20Simulation.md)
- [Руководство по поиску ошибок](Vivado%20Basics/Debug%20manual.md)
- [Руководство по прошивке ПЛИС](Vivado%20Basics/How%20to%20program%20an%20fpga%20board.md)

# Дополнительные материалы

- [RV32I - Стандартный набор целочисленных инструкций RISC-V](Other/rv32i.md)
- [Список типичных ошибок при работе с Vivado и SystemVerilog](Other/FAQ.md)